하이닉스, TSV기술 40나노급 8단 적층 성공

(아주경제 조영빈 기자) 하이닉스반도체는 9일 TSV(Through Silicon Via, 관통 전극) 기술을 활용해 40나노급 2기가비트 DDR3 D램을 8단 적층하는데 성공했다고 밝혔다. 단일 패키지에서 고용량 16기가비트를 구현하게 된 것은 이번이 처음이다.

통상 16기가비트 D램은 현재의 와이어 본딩(Wire bonding) 기술로는 패키지 크기 증가와 전기적 특성 저하로 인해 단일 패키지로 제작이 불가능하고, 20나노 초반급 공정기술을 적용한 4기가비트 D램이 개발되어야 구현이 가능하다.

이번에 개발된 제품은 TSV 기술을 활용해 이러한 한계를 극복하고 2기가비트 D램을 8단으로 수직 적층함으로써 하나의 패키지에서 고용량을 구현하게 됐다. 이 제품을 모듈로 제작하면 최대 64기가바이트의 고용량을 구현할 수 있어 서버 및 워크스테이션 등 대용량 메모리 수요에 적합하다는 것이 회사측의 설명이다.

기존의 MCP(Multi Chip Package)나 PoP(Package On Package) 등의 방식에서는 고용량화를 위해 칩을 적층할수록 신호전달을 위한 와이어가 복잡해지고 패키지의 크기가 커지는 단점이 있었다. 이러한 한계를 극복하기 위해 칩을 수직으로 적층해 관통전극을 형성하는 TSV 기술이 주목받고 있다. 기존의 와이어 본딩 방식에 비해 2배 이상 적층이 가능하면서 동작속도는 50%가량 향상되고 소비전력도 40% 줄어드는 것이 특징이다.

하이닉스반도체 연구소장 홍성주 전무는 “TSV 기술을 이용한 고용량 메모리 제조 기술은 향후 2~3년 내에 메모리 산업의 핵심기술이 될 것”이라며 “이번 제품 개발은 고용량과 융복합화로 변화하는 메모리 솔루션의 기반을 구축했다는 점에 그 의의가 있다”고 밝혔다.